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| LEADER |
00000cam a2200000 a 4500 |
| 001 |
TE-223 |
| 005 |
20230308192026.0 |
| 008 |
000000|1998 ||||||||r|||||||||||spa|| |
| 040 |
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|b spa
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| 041 |
1 |
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|a spa
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| 245 |
1 |
1 |
|a Diseño y construcción de un controlador lógico programable
|c Juan Chávez Cárdenas y Diego Peñaloza Rivera. Director Jan Doutreloigne y Hugo Viteri
|h dact
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| 264 |
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|a Cuenca
|c 1998
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| 300 |
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|a 104 páginas:
|b ilu
|c 29 cm
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| 500 |
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|a Incluye 5 anexos y 22 planos
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| 502 |
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|a Ingeniero Eléctrico
|b Universidad de Cuenca
|c ing
|d Doutreloigne, Jan, dir.
|e INGENIERIA ELECTRICA
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| 504 |
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|a incl. ref.
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| 520 |
3 |
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|a El PLC diseñado para fines industriales maneja hasta 1 Kw con 127 VCA, sus entradas aceptan señales digitales de 24 VCC a través de una fuente externa. El PLC está formado por un circuito acondicionador de la señal de entrada integrado en un comparador y un sistema de aislamiento óptico, el procesamiento de información se realiza en un microcontrolador 80C31 y una EEPROM 28C64, el sistema de salida está formado por aptoaclopladores y circuitos de manejo de potencia y por último el sistema de comunicación PC-PLC. La programación se realiza en la lógica de escalera desarrollado en visual C++ para el entorno gráfico de Windows
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| 650 |
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|a Controlador logico programable
|9 133164
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| 650 |
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|a Plc
|9 133165
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| 650 |
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|a Control de procesos
|9 50596
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| 650 |
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0 |
|a Electrónica
|9 9045
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| 700 |
1 |
|
|a Chávez Cárdenas, Juan
|e coautor
|9 133166
|
| 700 |
1 |
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|a Peñaloza Rivera, Diego
|e coautor
|9 133167
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| 852 |
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|a UC-CDJBV
|c CUARTO PISO (SECCION TESIS)
|f Donación
|k mariana.quezada
|l 1
|m Limitada
|p 00000000
|t TE-223
|b 1
|d CDRC
|e CDRC
|g CUARTO PISO (SECCION TESIS)
|z 0000-00-00
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| 942 |
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|c TS
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| 999 |
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|c 78133
|d 78133
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